♥ 반도체, AI 기술 자료 (15건) 참고하시기 바랍니다.
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| NO | 키워드 | 제목 / 내용 요약 | 등록일 | 출처 | URL |
| T1 | 복합동박, 유리기판 | 태성 기업설명회(IR) 자료 : 복합동박·유리기판·FC-BGA·SoCAMM·ESS > 3축 성장 엔진으로 여는 차세대 패키징/배터리 장비 리더십 > 3대 차세대 성장 동력 확보: 배터리 에너지 밀도를 높이는 복합동박, AI 반도체용 유리기판(Glass Substrate), 그리고 고성능 기판인 FC-BGA/SoCAMM을 미래 성장을 위한 3대 핵심 축으로 설정했습니다. 독보적인 공정 장비 기술: 업계 최고 수준의 양산 수율(98%)을 기록 중인 복합동박 장비와 유리기판용 TGV(유리 관통 전극) 에칭 등 미세 회로 구현을 위한 핵심 공정 IP를 내재화하고 있습니다. 글로벌 시장 확장 전략: 한국을 R&D 및 핵심 IP 거점으로, 중국을 대규모 제조 및 현지 영업 기지로 활용하며 북미와 유럽 등 글로벌 파트너십을 통해 장기적인 밸류체인 구축에 집중하고 있습니다. |
2025-11-07 | 태성 | https://share.google/7WVF9kKUwhSJIdnk4 |
| T2 | Area Laser Solution | 레이저쎌 IR Book(Fn) : global no.1 Area Laser Solution Platform > 독보적인 면레이저 기술: 점(Point)이나 선(Line)이 아닌 면(Area) 형태로 레이저를 조사하여 기판의 휨(Warpage) 현상을 방지하고 공정 속도를 획기적으로 높이는 LCF(Laser Compression Flow) 및 LSR(Laser Selective Reflow) 기술을 보유하고 있습니다. 반도체 패키징 시장 공략: AI 반도체 확산에 따른 HBM(고대역폭 메모리) 및 칩렛(Chiplet) 패키징 공정에서 기존의 매스 리플로우(Mass Reflow)나 TCB 방식의 한계를 극복할 수 있는 차세대 접합 솔루션으로 주목받고 있습니다. 사업 확장 및 성장 전략: 반도체뿐만 아니라 미니/마이크로 LED 디스플레이, 전기차(EV) 배터리 공정 등으로 적용 분야를 확대하고 있으며, 글로벌 반도체 기업들과의 협업을 통해 매출 성장을 본격화하고 있습니다. |
2025-09-18 | 한국IR협의회 | https://share.google/Et1NLbuNKC1C6QEUd |
| T3 | FOWLP, RDL | Development and Optimization of Fine-Pitch RDL for RDL Interposer and Embedded Bridge Die Interposer Fabrication Using Fan-Out Wafer-Level Packaging Technology > 공정 최적화: 칩렛 및 HBM 통합을 위한 FOWLP 환경에서 **2μm/2μm 선폭(L/S)**의 미세 RDL을 구현하기 위해, 노광 에너지와 열처리 조건 등 핵심 리소그래피 변수를 체계적으로 최적화했습니다. 신뢰성 및 성능 검증: 단면 분석을 통해 구조적 무결성을 확인했으며, HBM3 신호 할당 기준의 전기적 시뮬레이션을 수행하여 해당 RDL 구조가 고속 데이터 전송을 지원할 수 있는 실무적 타당성을 확보했습니다. 공정 가이드라인 제시: 지터와 노이즈 해결을 위한 추가 최적화 필요성을 식별함과 동시에, 차세대 반도체 패키징 적용을 위한 **2μm급 RDL 공정 마진(Process Window)**에 대한 공학적 지침을 마련했습니다. |
2026-02-12 | MDPI | https://share.google/wYOog8PE4ETGNLs6j |
| T4 | Bonding, Cu Pillar | Enhancing Bonding Strength of the Electroplated Cu Pillars for Semiconductor Package by Controlling Grain Orientation > 제공해주신 첨부 파일()은 반도체 패키징에 사용되는 구리 기둥(Cu pillar) 범프의 접합 강도 향상 연구에 관한 학술 논문입니다. 주요 내용을 3줄 요약하고 대표 키워드를 정리해 드립니다.3줄 요약전류 밀도와 미세구조의 상관관계: 구리 전해 도금 시 전류 밀도(ASD)가 낮을수록(3.0 ASD) (111) 결정 배향을 가진 조대 관상형 결정립이 형성되고, 밀도가 높을수록 결정립이 미세해지며 무작위 배향이 나타납니다. 언더컷(Undercut) 및 기계적 신뢰성: 높은 전류 밀도에서 형성된 미세 결정립은 식각 공정 중 더 긴 언더컷을 발생시키며, 이로 인해 유효 접합 면적이 감소하여 전단 강도(Shear strength)가 최대 50%까지 급격히 저하됩니다. 최적의 공정 조건 제시: TCAD 시뮬레이션 결과 언더컷이 응력 집중의 주요 원인임을 확인하였으며, 차세대 반도체 패키징의 신뢰성을 위해 낮은 전류 밀도로 언더컷을 최소화하고 특정 결정 배향을 제어하는 것이 필수적입니다. |
2026-01-31 | Scientific Reports | https://share.google/thjjl74ETqSL1poJy |
| T5 | DDR6 | DDR6 Explained : Speeds, Architecture, Release Date > 성능 혁신: DDR6는 기존 DDR5 대비 약 2~3배 향상된 8,800~17,600 MT/s의 데이터 전송 속도를 목표로 하며, 채널 구조를 4개의 24비트 서브 채널로 재설계하여 신호 무결성과 대역폭 효율을 극대화했습니다. 차세대 폼팩터 도입: 고속 주행 시 발생하는 신호 간섭과 열 문제를 해결하기 위해 기존 DIMM 방식 대신 압착 장착 방식인 CAMM2 폼팩터를 표준으로 채택하고 전력 관리 기능을 강화했습니다. 출시 및 시장 전망: 2024년 말 초안 규격이 완료되어 2027년경 AI 서버 및 고성능 컴퓨팅(HPC) 시장부터 우선 도입될 전망이나, 초기 제조 비용이 매우 높고 메인보드 설계 변경이 필요해 대중화까지는 시간이 걸릴 것으로 보입니다. |
2025-12-27 | IntuitionLabs | https://share.google/pgCS2E2cRQK0U3nAT |
| T6 | DRAM Fault | DRAM Fault Classification through Large-Scale Field Monitoring for Robust Memory RAS Management > 대규모 데이터 기반 고장 분석: 실제 컴퓨팅 환경에서 발생하는 대규모 DRAM 오류 데이터를 수집하고, 이를 하드웨어 구조(Row, Column, Bank 등)에 따라 체계적으로 분류하는 새로운 프레임워크를 제안했습니다. 고장 패턴 식별 및 예측: 단일 비트 오류뿐만 아니라 특정 행(Row)이나 열(Column) 전체에 발생하는 반복적 고장 패턴을 분석하여, 잠재적인 하드웨어 결함과 일시적인 소프트 오류를 정밀하게 구분해냈습니다. 메모리 관리 효율성 증대: 이 분류 체계를 통해 불필요한 메모리 교체를 줄이고, 고장이 예상되는 지점을 미리 격리하는 등 데이터 센터 및 서버 환경에서의 신뢰성(RAS) 관리 비용을 최적화할 수 있는 방안을 제시했습니다. |
2025-10-28 | ACM Digital Libray | https://share.google/75dX93jyL2JEJSd6e |
| T7 | Memory Retention | Memory Retention Is Not Enough to Master Memory Tasks in Reinforcement Learning > 메모리 갱신(Rewriting)의 중요성: 기존 RL 연구가 정보의 '유지'에만 집중해온 것과 달리, 이 연구는 환경 변화에 맞춰 과거 정보를 지우고 새로운 정보로 업데이트하는 메모리 갱신 능력의 필수성을 강조합니다. 벤치마크 도입 및 모델 비교: 부분 관측 가능성(Partial observability) 환경에서 메모리 갱신 능력을 평가하는 새로운 벤치마크를 도입하여 순환 신경망(RNN), 트랜스포머, 구조화된 메모리 아키텍처를 비교 분석했습니다. 기존 모델의 한계 확인: 실험 결과, 최신 트랜스포머나 구조화된 메모리보다 **전통적인 순환 모델(Recurrent models)**이 메모리 갱신에서 더 높은 유연성과 견고함을 보였으며, 이는 향후 에이전트 설계 시 '적응형 망각 메커니즘'이 필요함을 시사합니다. |
2026-01-20 | arXiv | https://share.google/htC09MC0G2QLyplWf |
| T8 | ADTechnology, Design House | 에이디테크놀로지 > 삼성전자 파운드리 핵심 파트너: 암(Arm)의 디자인 파트너(ADP)이자 삼성전자 파운드리의 국내 유일 '글로벌 디자인 솔루션 파트너(GSP)'로서, 미세 공정(5nm 이하) 기반의 고난도 ASIC 설계 서비스를 제공합니다. AI 및 HPC 중심의 포트폴리오 확장: 과거 모바일 중심에서 벗어나 차세대 데이터센터용 서버(Neoverse CSS V3), AI 가속기, HPC 아키텍처 플랫폼 개발 등 고부가가치 시장으로 사업 구조를 성공적으로 전환하고 있습니다. 매출 성장 및 수익성 개선 기대: 2025년 매출이 전년 대비 약 68% 증가한 1,787억 원 규모로 추정되며, 자체 IP 개발과 글로벌 기업과의 협업 확대를 통해 단순 설계 대행을 넘어 독자적인 플랫폼 기업으로 도약 중입니다. |
2025-10-23 | 로아 AI | https://share.google/6zbVWEVMPePeEjlHq |
| T9 | CPU, SOC | Architecting Memory Coherency Between CPU and Accelerators in Heterogeneous SoCs > 이기종 통합 시스템의 부상: 현대 컴퓨팅은 성능과 효율을 위해 CPU, GPU, FPGA 등이 한 칩에 통합된 이기종 SoC 구조로 변화했으며, 이에 따라 모든 프로세서가 동일한 메모리 데이터를 보는 '메모리 일관성(Memory Coherence)' 유지가 핵심 과제가 되었습니다. 기술적 진화와 상호 연결: 전통적인 스누핑(Snooping) 방식에서 현대적인 CXL, Infinity Fabric, NVLink-C2C 등 고성능 인터커넥트 기술 기반의 하이브리드 구현으로 발전하며 고속 데이터 공유를 가능하게 하고 있습니다. 시스템 설계의 근간으로 변화: 하드웨어 프로토콜과 소프트웨어 모델(Intel USM 등) 간의 시너지를 통해 복잡성을 해결하고 있으며, 이제 메모리 일관성은 단순한 설계를 넘어 차세대 고성능 컴퓨팅 플랫폼의 필수적인 시스템 설계 원칙이 되었습니다. |
2025-04-16 | ResearchGate | https://share.google/Q8Bt2VS1VpOFla8dk |
| T10 | 3D VLSI Reliability | Multi-Partner Project: COIN-3D -- Collaborative Innovation in 3D VLSI Reliability > 칩렛(Chiplet) 기술의 부상: 반도체 공정이 초미세화(GAAFET 등)됨에 따라 발생하는 제조 복잡성과 수율 저하 문제를 해결하기 위해, 여러 기능을 분리해 제조한 뒤 결합하는 3D 칩렛 기반의 이기종 통합 방식이 핵심 대안으로 주목받고 있습니다. 효율적인 시스템 설계: 칩렛 패러다임은 서로 다른 공정으로 만든 CPU, GPU, 메모리 등을 모듈식으로 구성할 수 있게 하여, 대형 단일 칩 설계보다 제조 수율을 높이고 비용 효율적인 시스템 구축을 가능하게 합니다. COIN-3D 프로젝트의 목표: 유럽의 Horizon Europe Twinning 프로젝트인 COIN-3D는 이러한 3D VLSI 시스템의 신뢰성을 평가하기 위해 물리적·시스템적 분석 알고리즘이 통합된 차세대 오픈소스 설계 자동화(EDA) 도구 개발을 추진하고 있습니다. |
arXiv | https://share.google/iDBlZZalRQuI855Xj | |
| T11 | AI, Design | Report for NSF Workshop on AI for Electronic Design Automation > 행사 목적: NeurIPS 2024와 병행 개최된 이 워크숍은 머신러닝(LLM, GNN, RL 등) 기술을 전자설계자동화(EDA)에 접목하여 하드웨어 설계 기간을 단축하고 효율성을 높이는 방안을 논의했습니다. 4대 주요 주제: 물리적 합성 및 제조 고려 설계(DFM), 고수준 및 논리 합성(HLS/LLS), AI 최적화 툴박스, 테스트 및 검증(SAT 솔빙, 보안 등)을 아우르는 AI/EDA 통합 연구 분야를 다뤘습니다. 정책 제안: 보고서는 하드웨어 설계의 민주화와 차세대 시스템 구현을 위해 AI/EDA 협업 촉진, 파운데이션 모델 투자, 데이터 및 컴퓨팅 인프라 구축, 전문 인력 양성을 NSF에 권고했습니다. |
2025-01-22 | arXiv | https://share.google/DtrcFL7iWExOdL7zj |
| T12 | AI Agent Inference | Heterogenous Computing, The Key to Powering the Future of AI Agent Inference > AI 에이전트 중심의 패러다임 변화: 미래 AI 데이터 센터의 핵심 부하는 '훈련'에서 '추론'으로 이동하고 있으며, 특히 복잡한 작업을 수행하는 AI 에이전트의 추론 수요가 시스템 설계를 주도할 것으로 전망됩니다. 이기종 컴퓨팅의 필수성: 기존의 GPU 중심 인프라를 넘어, 성능과 에너지 효율을 극대화하기 위해 CPU, SmartNIC, 전용 AI 가속기(Rubin CPX 등)가 결합된 하드웨어 특화 및 이기종 통합이 핵심 해결책으로 제시됩니다. 시스템 계층 전반의 최적화: 단순히 하드웨어 가속에 그치지 않고, 추론 효율을 높이기 위한 알고리즘 최적화와 이기종 자원을 효율적으로 관리하는 시스템 소프트웨어 계층의 혁신이 필요함을 강조합니다. |
2026-01-29 | arXiv | https://share.google/sC7gAjJ1JhcushDUj |
| T13 | AI, ML, MRDIMM | Revolutionizing Memory for AI/ML's Future : MRDIMM > 대역폭 병목 현상 해결: AI/ML 모델의 급격한 성장에 따른 데이터 전송 속도와 용량 부족 문제를 해결하기 위해, 기존 DDR5 대비 훨씬 높은 대역폭을 제공하는 MR-DIMM(Multi-Ranked DIMM) 기술을 소개합니다. 혁신적인 아키텍처: 호스트와 DRAM 사이의 데이터 전송률을 2배로 높이는 **멀티플렉싱(Mux Mode)**과 병렬성을 강화한 의사 채널(Pseudo Channel) 구조를 통해 최대 12,800 MT/s 이상의 속도를 구현합니다. 생태계 호환성 및 확장성: 플랫폼의 전면적인 교체 없이 DDR5 생태계 및 CXL 메모리 확장 기술과 호환되며, 향후 DDR6로 이어지는 고성능 컴퓨팅(HPC)의 핵심 메모리 솔루션으로 자리 잡을 전망입니다. |
2025-08-06 | The Future of Memory and Storage | https://share.google/otPGnC9cXEtaURoNz |
| T14 | AI Networking Infrastructure | What’s Next for Networking Infrastructure for AI > 이더넷(Ethernet)의 부상: 기존 AI 네트워크를 주도하던 엔비디아의 인피니밴드(InfiniBand) 대신, 개방형 표준인 이더넷 기술이 추론(Inference) 인프라를 중심으로 점유율을 빠르게 확대하고 있습니다. 분산형 추론 인프라 확장: AI 모델이 거대 언어 모델(LLM)에서 소형 모델(SLM) 및 에이전트형 AI로 진화함에 따라, 데이터 센터부터 엣지(Edge)까지 연결하는 분산된 네트워킹 구조의 중요성이 커지고 있습니다. 보안 및 자동화 통합: 낮은 지연 시간과 높은 처리량을 보장하기 위해 SASE, SD-WAN, 멀티 클라우드 네트워킹(MCN) 기술이 AI 전용 인프라와 결합하며 보안과 운용 자동화가 강화되는 추세입니다. |
2025-05-14 | FUTURIUM | https://share.google/mGgDnTqkU1f7S3xI2 |
| T15 | 차세대 아키텍처, Quantum Computing | Advancements in Computer Hardware Technologies > 차세대 아키텍처로의 전환: 전통적인 CMOS 스케일링의 한계를 극복하기 위해 양자 컴퓨팅, 뉴로모픽(뇌 모방) 아키텍처, 3D 패키징 및 이기종 통합 기술이 핵심 혁신 동력으로 부상하고 있습니다. 성능 및 효율성 극대화: 3nm 이하의 미세 공정 기술, 메모리 지연 시간을 줄이는 신기술, 데이터 집약적 작업을 위한 광학 인터커넥트 등을 통해 고성능·저전력 컴퓨팅 시스템 구현을 목표로 합니다. 미래 과제와 협업의 필요성: 양자 오류 정정, 열 관리, 하드웨어 보안 등의 난제를 해결하기 위해 학계와 반도체 파운드리, 시스템 통합 업체 간의 긴밀한 협력과 지속 가능한 설계 관행이 필수적임을 강조합니다. |
2025-08-22 | IJEDR2503135 | https://share.google/7z9VkQeEmhaBCMEsM |